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(out, din, scanen, sin, clock) ;
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Mflipflop_s Mflipflop_s_31_20 (out[20], din[20], scanen, sin[20], clock);
Mflipflop_s Mflipflop_s_31_21 (out[21], din[21], scanen, sin[21], clock);
Mflipflop_s Mflipflop_s_31_22 (out[22], din[22], scanen, sin[22], clock);
Mflipflop_s Mflipflop_s_31_23 (out[23], din[23], scanen, sin[23], clock);
Mflipflop_s Mflipflop_s_31_24 (out[24], din[24], scanen, sin[24], clock);
Mflipflop_s Mflipflop_s_31_25 (out[25], din[25], scanen, sin[25], clock);
Mflipflop_s Mflipflop_s_31_26 (out[26], din[26], scanen, sin[26], clock);
Mflipflop_s Mflipflop_s_31_27 (out[27], din[27], scanen, sin[27], clock);
Mflipflop_s Mflipflop_s_31_28 (out[28], din[28], scanen, sin[28], clock);
Mflipflop_s Mflipflop_s_31_29 (out[29], din[29], scanen, sin[29], clock);
Mflipflop_s Mflipflop_s_31_30 (out[30], din[30], scanen, sin[30], clock);
Mflipflop_s Mflipflop_s_31_31 (out[31], din[31], scanen, sin[31], clock);
endmodule
module Mflipflop_h_1
(out, din, enable_l, clock) ;
output out
;
input din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_0_32 (out, din, enable_l, clock);
endmodule
module Mflipflop_h_2
(out, din, enable_l, clock) ;
output [1:0] out
;
input [1:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_1_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_1_1 (out[1], din[1], enable_l, clock);
endmodule
module Mflipflop_h_3
(out, din, enable_l, clock) ;
output [2:0] out
;
input [2:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_2_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_2_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_2_2 (out[2], din[2], enable_l, clock);
endmodule
module Mflipflop_h_4
(out, din, enable_l, clock) ;
output [3:0] out
;
input [3:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_3_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_3_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_3_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_3_3 (out[3], din[3], enable_l, clock);
endmodule
module Mflipflop_h_5
(out, din, enable_l, clock) ;
output [4:0] out
;
input [4:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_4_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_4_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_4_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_4_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_4_4 (out[4], din[4], enable_l, clock);
endmodule
module Mflipflop_h_6
(out, din, enable_l, clock) ;
output [5:0] out
;
input [5:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_5_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_5_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_5_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_5_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_5_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_5_5 (out[5], din[5], enable_l, clock);
endmodule
module Mflipflop_h_7
(out, din, enable_l, clock) ;
output [6:0] out
;
input [6:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_6_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_6_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_6_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_6_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_6_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_6_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_6_6 (out[6], din[6], enable_l, clock);
endmodule
module Mflipflop_h_8
(out, din, enable_l, clock) ;
output [7:0] out
;
input [7:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_7_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_7_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_7_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_7_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_7_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_7_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_7_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_7_7 (out[7], din[7], enable_l, clock);
endmodule
![[Up: CAM_LINE cam_line_32_40]](v2html-up.gif)
module Mflipflop_h_9
(out, din, enable_l, clock) ;
output [8:0] out
;
input [8:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_8_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_8_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_8_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_8_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_8_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_8_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_8_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_8_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_8_8 (out[8], din[8], enable_l, clock);
endmodule
module Mflipflop_h_10
(out, din, enable_l, clock) ;
output [9:0] out
;
input [9:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_9_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_9_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_9_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_9_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_9_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_9_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_9_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_9_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_9_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_9_9 (out[9], din[9], enable_l, clock);
endmodule
module Mflipflop_h_11
(out, din, enable_l, clock) ;
output [10:0] out
;
input [10:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_10_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_10_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_10_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_10_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_10_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_10_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_10_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_10_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_10_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_10_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_10_10 (out[10], din[10], enable_l, clock);
endmodule
module Mflipflop_h_12
(out, din, enable_l, clock) ;
output [11:0] out
;
input [11:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_11_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_11_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_11_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_11_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_11_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_11_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_11_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_11_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_11_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_11_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_11_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_11_11 (out[11], din[11], enable_l, clock);
endmodule
module Mflipflop_h_13
(out, din, enable_l, clock) ;
output [12:0] out
;
input [12:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_12_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_12_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_12_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_12_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_12_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_12_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_12_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_12_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_12_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_12_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_12_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_12_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_12_12 (out[12], din[12], enable_l, clock);
endmodule
module Mflipflop_h_14
(out, din, enable_l, clock) ;
output [13:0] out
;
input [13:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_13_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_13_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_13_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_13_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_13_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_13_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_13_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_13_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_13_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_13_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_13_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_13_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_13_12 (out[12], din[12], enable_l, clock);
Mflipflop_h Mflipflop_h_13_13 (out[13], din[13], enable_l, clock);
endmodule
module Mflipflop_h_15
(out, din, enable_l, clock) ;
output [14:0] out
;
input [14:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_14_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_14_1 (out[1], din[1], enable_l, clock);
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Mflipflop_h Mflipflop_h_14_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_14_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_14_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_14_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_14_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_14_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_14_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_14_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_14_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_14_12 (out[12], din[12], enable_l, clock);
Mflipflop_h Mflipflop_h_14_13 (out[13], din[13], enable_l, clock);
Mflipflop_h Mflipflop_h_14_14 (out[14], din[14], enable_l, clock);
endmodule
module Mflipflop_h_16
(out, din, enable_l, clock) ;
output [15:0] out
;
input [15:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_15_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_15_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_15_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_15_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_15_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_15_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_15_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_15_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_15_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_15_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_15_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_15_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_15_12 (out[12], din[12], enable_l, clock);
Mflipflop_h Mflipflop_h_15_13 (out[13], din[13], enable_l, clock);
Mflipflop_h Mflipflop_h_15_14 (out[14], din[14], enable_l, clock);
Mflipflop_h Mflipflop_h_15_15 (out[15], din[15], enable_l, clock);
endmodule
module Mflipflop_h_17
(out, din, enable_l, clock) ;
output [16:0] out
;
input [16:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_16_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_16_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_16_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_16_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_16_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_16_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_16_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_16_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_16_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_16_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_16_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_16_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_16_12 (out[12], din[12], enable_l, clock);
Mflipflop_h Mflipflop_h_16_13 (out[13], din[13], enable_l, clock);
Mflipflop_h Mflipflop_h_16_14 (out[14], din[14], enable_l, clock);
Mflipflop_h Mflipflop_h_16_15 (out[15], din[15], enable_l, clock);
Mflipflop_h Mflipflop_h_16_16 (out[16], din[16], enable_l, clock);
endmodule
module Mflipflop_h_18
(out, din, enable_l, clock) ;
output [17:0] out
;
input [17:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_17_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_17_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_17_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_17_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_17_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_17_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_17_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_17_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_17_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_17_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_17_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_17_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_17_12 (out[12], din[12], enable_l, clock);
Mflipflop_h Mflipflop_h_17_13 (out[13], din[13], enable_l, clock);
Mflipflop_h Mflipflop_h_17_14 (out[14], din[14], enable_l, clock);
Mflipflop_h Mflipflop_h_17_15 (out[15], din[15], enable_l, clock);
Mflipflop_h Mflipflop_h_17_16 (out[16], din[16], enable_l, clock);
Mflipflop_h Mflipflop_h_17_17 (out[17], din[17], enable_l, clock);
endmodule
module Mflipflop_h_19
(out, din, enable_l, clock) ;
output [18:0] out
;
input [18:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_18_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_18_1 (out[1], din[1], enable_l, clock);
Mflipflop_h Mflipflop_h_18_2 (out[2], din[2], enable_l, clock);
Mflipflop_h Mflipflop_h_18_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_18_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_18_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_18_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_18_7 (out[7], din[7], enable_l, clock);
Mflipflop_h Mflipflop_h_18_8 (out[8], din[8], enable_l, clock);
Mflipflop_h Mflipflop_h_18_9 (out[9], din[9], enable_l, clock);
Mflipflop_h Mflipflop_h_18_10 (out[10], din[10], enable_l, clock);
Mflipflop_h Mflipflop_h_18_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_18_12 (out[12], din[12], enable_l, clock);
Mflipflop_h Mflipflop_h_18_13 (out[13], din[13], enable_l, clock);
Mflipflop_h Mflipflop_h_18_14 (out[14], din[14], enable_l, clock);
Mflipflop_h Mflipflop_h_18_15 (out[15], din[15], enable_l, clock);
Mflipflop_h Mflipflop_h_18_16 (out[16], din[16], enable_l, clock);
Mflipflop_h Mflipflop_h_18_17 (out[17], din[17], enable_l, clock);
Mflipflop_h Mflipflop_h_18_18 (out[18], din[18], enable_l, clock);
endmodule
module Mflipflop_h_20
(out, din, enable_l, clock) ;
output [19:0] out
;
input [19:0] din
;
input enable_l
;
input clock
;
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endmodule
module Mflipflop_h_21
(out, din, enable_l, clock) ;
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endmodule
module Mflipflop_h_22
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endmodule
module Mflipflop_h_23
(out, din, enable_l, clock) ;
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endmodule
module Mflipflop_h_24
(out, din, enable_l, clock) ;
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;
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input clock
;
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endmodule
module Mflipflop_h_25
(out, din, enable_l, clock) ;
output [24:0] out
;
input [24:0] din
;
input enable_l
;
input clock
;
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endmodule
module Mflipflop_h_26
(out, din, enable_l, clock) ;
output [25:0] out
;
input [25:0] din
;
input enable_l
;
input clock
;
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endmodule
module Mflipflop_h_27
(out, din, enable_l, clock) ;
output [26:0] out
;
input [26:0] din
;
input enable_l
;
input clock
;
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Mflipflop_h Mflipflop_h_26_17 (out[17], din[17], enable_l, clock);
Mflipflop_h Mflipflop_h_26_18 (out[18], din[18], enable_l, clock);
Mflipflop_h Mflipflop_h_26_19 (out[19], din[19], enable_l, clock);
Mflipflop_h Mflipflop_h_26_20 (out[20], din[20], enable_l, clock);
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endmodule
module Mflipflop_h_28
(out, din, enable_l, clock) ;
output [27:0] out
;
input [27:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_27_0 (out[0], din[0], enable_l, clock);
Mflipflop_h Mflipflop_h_27_1 (out[1], din[1], enable_l, clock);
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Mflipflop_h Mflipflop_h_27_3 (out[3], din[3], enable_l, clock);
Mflipflop_h Mflipflop_h_27_4 (out[4], din[4], enable_l, clock);
Mflipflop_h Mflipflop_h_27_5 (out[5], din[5], enable_l, clock);
Mflipflop_h Mflipflop_h_27_6 (out[6], din[6], enable_l, clock);
Mflipflop_h Mflipflop_h_27_7 (out[7], din[7], enable_l, clock);
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Mflipflop_h Mflipflop_h_27_11 (out[11], din[11], enable_l, clock);
Mflipflop_h Mflipflop_h_27_12 (out[12], din[12], enable_l, clock);
Mflipflop_h Mflipflop_h_27_13 (out[13], din[13], enable_l, clock);
Mflipflop_h Mflipflop_h_27_14 (out[14], din[14], enable_l, clock);
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Mflipflop_h Mflipflop_h_27_17 (out[17], din[17], enable_l, clock);
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endmodule
module Mflipflop_h_29
(out, din, enable_l, clock) ;
output [28:0] out
;
input [28:0] din
;
input enable_l
;
input clock
;
Mflipflop_h Mflipflop_h_28_0 (out[0], din[0], enable_l, clock);
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endmodule
module Mflipflop_h_30
(out, din, enable_l, clock) ;
output [29:0] out
;
input [29:0] din
;
input enable_l
;
input clock
;
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Created: | Thu Aug 19 11:59:09 1999 |
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