endmodule
module Mflipflop_sr_15
(out, din, scanen, sin, reset_l, clock) ;
output [14:0] out ;
input [14:0] din ;
input scanen ;
input [14:0] sin ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_sr_16 (out, din, scanen, sin, reset_l, clock) ;
output [15:0] out ;
input [15:0] din ;
input scanen ;
input [15:0] sin ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_sr_17 (out, din, scanen, sin, reset_l, clock) ;
output [16:0] out ;
input [16:0] din ;
input scanen ;
input [16:0] sin ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_sr_18 (out, din, scanen, sin, reset_l, clock) ;
output [17:0] out ;
input [17:0] din ;
input scanen ;
input [17:0] sin ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_sr_19 (out, din, scanen, sin, reset_l, clock) ;
output [18:0] out ;
input [18:0] din ;
input scanen ;
input [18:0] sin ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_sr_20 (out, din, scanen, sin, reset_l, clock) ;
output [19:0] out ;
input [19:0] din ;
input scanen ;
input [19:0] sin ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_sr_21 (out, din, scanen, sin, reset_l, clock) ;
output [20:0] out ;
input [20:0] din ;
input scanen ;
input [20:0] sin ;
input reset_l ;
input clock ;
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Mflipflop_sr Mflipflop_sr_20_7 (out[7], din[7], scanen, sin[7], reset_l, clock);
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endmodule
module Mflipflop_sr_22 (out, din, scanen, sin, reset_l, clock) ;
output [21:0] out ;
input [21:0] din ;
input scanen ;
input [21:0] sin ;
input reset_l ;
input clock ;
Mflipflop_sr Mflipflop_sr_21_0 (out[0], din[0], scanen, sin[0], reset_l, clock);
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Mflipflop_sr Mflipflop_sr_21_14 (out[14], din[14], scanen, sin[14], reset_l, clock);
Mflipflop_sr Mflipflop_sr_21_15 (out[15], din[15], scanen, sin[15], reset_l, clock);
Mflipflop_sr Mflipflop_sr_21_16 (out[16], din[16], scanen, sin[16], reset_l, clock);
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Mflipflop_sr Mflipflop_sr_21_18 (out[18], din[18], scanen, sin[18], reset_l, clock);
Mflipflop_sr Mflipflop_sr_21_19 (out[19], din[19], scanen, sin[19], reset_l, clock);
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Mflipflop_sr Mflipflop_sr_21_21 (out[21], din[21], scanen, sin[21], reset_l, clock);
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module Mflipflop_sr_23 (out, din, scanen, sin, reset_l, clock) ;
output [22:0] out ;
input [22:0] din ;
input scanen ;
input [22:0] sin ;
input reset_l ;
input clock ;
Mflipflop_sr Mflipflop_sr_22_0 (out[0], din[0], scanen, sin[0], reset_l, clock);
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Mflipflop_sr Mflipflop_sr_22_3 (out[3], din[3], scanen, sin[3], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_4 (out[4], din[4], scanen, sin[4], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_5 (out[5], din[5], scanen, sin[5], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_6 (out[6], din[6], scanen, sin[6], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_7 (out[7], din[7], scanen, sin[7], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_8 (out[8], din[8], scanen, sin[8], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_9 (out[9], din[9], scanen, sin[9], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_10 (out[10], din[10], scanen, sin[10], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_11 (out[11], din[11], scanen, sin[11], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_12 (out[12], din[12], scanen, sin[12], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_13 (out[13], din[13], scanen, sin[13], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_14 (out[14], din[14], scanen, sin[14], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_15 (out[15], din[15], scanen, sin[15], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_16 (out[16], din[16], scanen, sin[16], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_17 (out[17], din[17], scanen, sin[17], reset_l, clock);
Mflipflop_sr Mflipflop_sr_22_18 (out[18], din[18], scanen, sin[18], reset_l, clock);
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Mflipflop_sr Mflipflop_sr_22_22 (out[22], din[22], scanen, sin[22], reset_l, clock);
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module Mflipflop_sr_24 (out, din, scanen, sin, reset_l, clock) ;
output [23:0] out ;
input [23:0] din ;
input scanen ;
input [23:0] sin ;
input reset_l ;
input clock ;
Mflipflop_sr Mflipflop_sr_23_0 (out[0], din[0], scanen, sin[0], reset_l, clock);
Mflipflop_sr Mflipflop_sr_23_1 (out[1], din[1], scanen, sin[1], reset_l, clock);
Mflipflop_sr Mflipflop_sr_23_2 (out[2], din[2], scanen, sin[2], reset_l, clock);
Mflipflop_sr Mflipflop_sr_23_3 (out[3], din[3], scanen, sin[3], reset_l, clock);
Mflipflop_sr Mflipflop_sr_23_4 (out[4], din[4], scanen, sin[4], reset_l, clock);
Mflipflop_sr Mflipflop_sr_23_5 (out[5], din[5], scanen, sin[5], reset_l, clock);
Mflipflop_sr Mflipflop_sr_23_6 (out[6], din[6], scanen, sin[6], reset_l, clock);
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module Mflipflop_sr_31 (out, din, scanen, sin, reset_l, clock) ;
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input clock ;
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endmodule
module Mflipflop_sr_32 (out, din, scanen, sin, reset_l, clock) ;
output [31:0] out ;
input [31:0] din ;
input scanen ;
input [31:0] sin ;
input reset_l ;
input clock ;
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endmodule
![[Up: rl_tw_sm mc_mstb_reg_1]](v2html-up.gif)
... (truncated)
module Mflipflop_r_1 (out, din, reset_l, clock) ;
output out ;
input din ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_r_2 (out, din, reset_l, clock) ;
output [1:0] out ;
input [1:0] din ;
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endmodule
module Mflipflop_r_3 (out, din, reset_l, clock) ;
output [2:0] out ;
input [2:0] din ;
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endmodule
module Mflipflop_r_4 (out, din, reset_l, clock) ;
output [3:0] out ;
input [3:0] din ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_r_5 (out, din, reset_l, clock) ;
output [4:0] out ;
input [4:0] din ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_r_6 (out, din, reset_l, clock) ;
output [5:0] out ;
input [5:0] din ;
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input clock ;
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endmodule
module Mflipflop_r_7 (out, din, reset_l, clock) ;
output [6:0] out ;
input [6:0] din ;
input reset_l ;
input clock ;
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Mflipflop_r Mflipflop_r_6_6 (out[6], din[6], reset_l, clock);
endmodule
module Mflipflop_r_8 (out, din, reset_l, clock) ;
output [7:0] out ;
input [7:0] din ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_r_9 (out, din, reset_l, clock) ;
output [8:0] out ;
input [8:0] din ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_r_10 (out, din, reset_l, clock) ;
output [9:0] out ;
input [9:0] din ;
input reset_l ;
input clock ;
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Mflipflop_r Mflipflop_r_9_7 (out[7], din[7], reset_l, clock);
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Mflipflop_r Mflipflop_r_9_9 (out[9], din[9], reset_l, clock);
endmodule
module Mflipflop_r_11 (out, din, reset_l, clock) ;
output [10:0] out ;
input [10:0] din ;
input reset_l ;
input clock ;
Mflipflop_r Mflipflop_r_10_0 (out[0], din[0], reset_l, clock);
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Mflipflop_r Mflipflop_r_10_2 (out[2], din[2], reset_l, clock);
Mflipflop_r Mflipflop_r_10_3 (out[3], din[3], reset_l, clock);
Mflipflop_r Mflipflop_r_10_4 (out[4], din[4], reset_l, clock);
Mflipflop_r Mflipflop_r_10_5 (out[5], din[5], reset_l, clock);
Mflipflop_r Mflipflop_r_10_6 (out[6], din[6], reset_l, clock);
Mflipflop_r Mflipflop_r_10_7 (out[7], din[7], reset_l, clock);
Mflipflop_r Mflipflop_r_10_8 (out[8], din[8], reset_l, clock);
Mflipflop_r Mflipflop_r_10_9 (out[9], din[9], reset_l, clock);
Mflipflop_r Mflipflop_r_10_10 (out[10], din[10], reset_l, clock);
endmodule
module Mflipflop_r_12 (out, din, reset_l, clock) ;
output [11:0] out ;
input [11:0] din ;
input reset_l ;
input clock ;
Mflipflop_r Mflipflop_r_11_0 (out[0], din[0], reset_l, clock);
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Mflipflop_r Mflipflop_r_11_7 (out[7], din[7], reset_l, clock);
Mflipflop_r Mflipflop_r_11_8 (out[8], din[8], reset_l, clock);
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endmodule
module Mflipflop_r_13 (out, din, reset_l, clock) ;
output [12:0] out ;
input [12:0] din ;
input reset_l ;
input clock ;
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Mflipflop_r Mflipflop_r_12_8 (out[8], din[8], reset_l, clock);
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endmodule
module Mflipflop_r_14 (out, din, reset_l, clock) ;
output [13:0] out ;
input [13:0] din ;
input reset_l ;
input clock ;
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Mflipflop_r Mflipflop_r_13_1 (out[1], din[1], reset_l, clock);
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endmodule
module Mflipflop_r_15 (out, din, reset_l, clock) ;
output [14:0] out ;
input [14:0] din ;
input reset_l ;
input clock ;
Mflipflop_r Mflipflop_r_14_0 (out[0], din[0], reset_l, clock);
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endmodule
module Mflipflop_r_16 (out, din, reset_l, clock) ;
output [15:0] out ;
input [15:0] din ;
input reset_l ;
input clock ;
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endmodule
module Mflipflop_r_17 (out, din, reset_l, clock) ;
output [16:0] out ;
input [16:0] din ;
input reset_l ;
input clock ;
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Created: | Thu Aug 19 11:58:56 1999 |
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